Design Hierarchy
dashboard | hierarchy | modlist | groups | tests | asserts

NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
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dut 91.28 97.06 89.50 97.22 71.43 94.04 98.44
gen_alert_tx[0].u_prim_alert_sender 100.00 100.00
i2c_core 87.46 95.94 84.08 71.43 91.18 94.69
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u_inp_buf 94.32 100.00 81.82 95.45 100.00
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u_oup_buf 97.16 100.00 88.64 100.00 100.00
gen_normal_fifo.u_fifo_cnt 100.00 100.00 100.00 100.00
u_sram_ptrs 100.00 100.00 100.00 100.00
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u_sync_1 100.00 100.00 100.00
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u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
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u_reg 98.60 98.59 96.81 100.00 97.58 100.00
subtree...
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