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Assertions by Category
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Category 0923028

Assertions by Severity
ASSERTPROPERTIESSEQUENCES
Total923028
Severity 0923028

Summary for Assertions
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Success91799.35
Failure00.00
Incomplete40.43
Without Attempts00.00

Summary for Cover Sequences
NUMBERPERCENT
Total Number28100.00
Uncovered828.57
All Matches2071.43
First Matches2071.43

Detail Report for Assertions

Assertions Uncovered:
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Assertions Success:
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tb.dut.u_tlul_lc_gate_sba.u_state_regs_A 00484749834843615600
tb.dut.u_tlul_lc_gate_sba.u_tlul_err_resp.u_intg_gen.DataWidthCheck_A 0022322300
tb.dut.u_tlul_lc_gate_sba.u_tlul_err_resp.u_intg_gen.PayLoadWidthCheck 0022322300

Assertions Incomplete:
ASSERTIONSCATEGORYSEVERITYATTEMPTSREAL SUCCESSESFAILURESINCOMPLETESRC
tb.dut.u_pm_en_sync.gen_flops.OutputDelay_A 0048474983484344280669
tb.dut.u_prim_lc_sync_lc_dft_en.gen_flops.OutputDelay_A 0048474983484344280669
tb.dut.u_prim_lc_sync_lc_hw_debug_en.gen_flops.OutputDelay_A 0048474983484344280669
tb.dut.u_prim_mubi8_sync_otp_dis_rv_dm_late_debug.gen_flops.gen_no_stable_chks.OutputDelay_A 0048474983484344280669

Detail Report for Cover Sequences

Cover Sequences Uncovered:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_host_sba.gen_host_cov.b2bRsp_C 00135474819000
tb.dut.tlul_assert_host_sba.gen_host_cov.dValidNotAccepted_C 00135474819000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_dataChangedNotAccepted_C 00135474819000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_errorChangedNotAccepted_C 00135474819000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_opcodeChangedNotAccepted_C 00135474819000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_sinkChangedNotAccepted_C 00135474819000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_sizeChangedNotAccepted_C 00135474819000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_sourceChangedNotAccepted_C 00135474819000

Cover Sequences All Matches:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_device_mem.gen_device_cov.aValidNotAccepted_C 0013547481913717137170
tb.dut.tlul_assert_device_mem.gen_device_cov.a_addressChangedNotAccepted_C 00135474819251325132
tb.dut.tlul_assert_device_mem.gen_device_cov.a_dataChangedNotAccepted_C 00135474819258625862
tb.dut.tlul_assert_device_mem.gen_device_cov.a_maskChangedNotAccepted_C 00135474819153815382
tb.dut.tlul_assert_device_mem.gen_device_cov.a_opcodeChangedNotAccepted_C 001354748193923922
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sizeChangedNotAccepted_C 00135474819116411642
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sourceChangedNotAccepted_C 001354748193573572
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReqWithSameAddr_C 0013547481943003430030
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReq_C 0013547481990165901650
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bSameSource_C 00135474819154298154298102
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C 0013547481956560
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C 00135474819550
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C 00135474819550
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C 00135474819330
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C 00135474819220
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C 00135474819330
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C 00135474819110
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C 001354748194174170
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tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C 0013547481932503250270

Cover Sequences First Matches:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_device_mem.gen_device_cov.aValidNotAccepted_C 0013547481913717137170
tb.dut.tlul_assert_device_mem.gen_device_cov.a_addressChangedNotAccepted_C 00135474819251325132
tb.dut.tlul_assert_device_mem.gen_device_cov.a_dataChangedNotAccepted_C 00135474819258625862
tb.dut.tlul_assert_device_mem.gen_device_cov.a_maskChangedNotAccepted_C 00135474819153815382
tb.dut.tlul_assert_device_mem.gen_device_cov.a_opcodeChangedNotAccepted_C 001354748193923922
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sizeChangedNotAccepted_C 00135474819116411642
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sourceChangedNotAccepted_C 001354748193573572
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReqWithSameAddr_C 0013547481943003430030
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReq_C 0013547481990165901650
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bSameSource_C 00135474819154298154298102
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C 0013547481956560
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C 00135474819550
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C 00135474819550
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C 00135474819330
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C 00135474819220
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C 00135474819330
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C 00135474819110
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C 001354748194174170
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tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C 0013547481932503250270

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