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Assertions by Category
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Assertions by Severity
ASSERTPROPERTIESSEQUENCES
Total923028
Severity 0923028


Summary for Assertions
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Uncovered60.65
Success91799.35
Failure00.00
Incomplete40.43
Without Attempts00.00


Summary for Cover Sequences
NUMBERPERCENT
Total Number28100.00
Uncovered1450.00
All Matches1450.00
First Matches1450.00


Detail Report for Assertions

Assertions Uncovered:
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Assertions Success:
ASSERTIONSCATEGORYSEVERITYATTEMPTSREAL SUCCESSESFAILURESINCOMPLETESRC
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tb.dut.u_tlul_lc_gate_sba.u_state_regs_A 00582035155816696100
tb.dut.u_tlul_lc_gate_sba.u_tlul_err_resp.u_intg_gen.DataWidthCheck_A 0022122100
tb.dut.u_tlul_lc_gate_sba.u_tlul_err_resp.u_intg_gen.PayLoadWidthCheck 0022122100

Assertions Incomplete:
ASSERTIONSCATEGORYSEVERITYATTEMPTSREAL SUCCESSESFAILURESINCOMPLETESRC
tb.dut.u_pm_en_sync.gen_flops.OutputDelay_A 0058203515581652840663
tb.dut.u_prim_lc_sync_lc_dft_en.gen_flops.OutputDelay_A 0058203515581652840663
tb.dut.u_prim_lc_sync_lc_hw_debug_en.gen_flops.OutputDelay_A 0058203515581652840663
tb.dut.u_prim_mubi8_sync_otp_dis_rv_dm_late_debug.gen_flops.gen_no_stable_chks.OutputDelay_A 0058203515581652840663


Detail Report for Cover Sequences

Cover Sequences Uncovered:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_host_sba.gen_host_cov.b2bRsp_C 00117471579000
tb.dut.tlul_assert_host_sba.gen_host_cov.dValidNotAccepted_C 00117471579000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_dataChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_errorChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_opcodeChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_sinkChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_sizeChangedNotAccepted_C 00117471579000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_sourceChangedNotAccepted_C 00117471579000

Cover Sequences All Matches:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_device_mem.gen_device_cov.aValidNotAccepted_C 0011747157915062150620
tb.dut.tlul_assert_device_mem.gen_device_cov.a_addressChangedNotAccepted_C 00117471579218921891
tb.dut.tlul_assert_device_mem.gen_device_cov.a_dataChangedNotAccepted_C 00117471579224522451
tb.dut.tlul_assert_device_mem.gen_device_cov.a_maskChangedNotAccepted_C 00117471579137413741
tb.dut.tlul_assert_device_mem.gen_device_cov.a_opcodeChangedNotAccepted_C 001174715793303301
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sizeChangedNotAccepted_C 00117471579101210121
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sourceChangedNotAccepted_C 00117471579165216521
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReqWithSameAddr_C 0011747157924921249210
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReq_C 0011747157997760977600
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tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C 0011747157990900
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C 001174715792652650
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C 001174715795615610
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C 0011747157927292729267

Cover Sequences First Matches:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_device_mem.gen_device_cov.aValidNotAccepted_C 0011747157915062150620
tb.dut.tlul_assert_device_mem.gen_device_cov.a_addressChangedNotAccepted_C 00117471579218921891
tb.dut.tlul_assert_device_mem.gen_device_cov.a_dataChangedNotAccepted_C 00117471579224522451
tb.dut.tlul_assert_device_mem.gen_device_cov.a_maskChangedNotAccepted_C 00117471579137413741
tb.dut.tlul_assert_device_mem.gen_device_cov.a_opcodeChangedNotAccepted_C 001174715793303301
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sizeChangedNotAccepted_C 00117471579101210121
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sourceChangedNotAccepted_C 00117471579165216521
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReqWithSameAddr_C 0011747157924921249210
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReq_C 0011747157997760977600
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bSameSource_C 00117471579120823120823106
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tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C 0011747157927292729267

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