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Assertions by Category
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Assertions by Severity
ASSERTPROPERTIESSEQUENCES
Total923028
Severity 0923028

Summary for Assertions
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Success91799.35
Failure00.00
Incomplete40.43
Without Attempts00.00

Summary for Cover Sequences
NUMBERPERCENT
Total Number28100.00
Uncovered1139.29
All Matches1760.71
First Matches1760.71

Detail Report for Assertions

Assertions Uncovered:
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Assertions Success:
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tb.dut.u_tlul_lc_gate_sba.u_state_regs.AssertConnected_A 0022422400
tb.dut.u_tlul_lc_gate_sba.u_state_regs_A 00811990988115653700
tb.dut.u_tlul_lc_gate_sba.u_tlul_err_resp.u_intg_gen.DataWidthCheck_A 0022422400
tb.dut.u_tlul_lc_gate_sba.u_tlul_err_resp.u_intg_gen.PayLoadWidthCheck 0022422400

Assertions Incomplete:
ASSERTIONSCATEGORYSEVERITYATTEMPTSREAL SUCCESSESFAILURESINCOMPLETESRC
tb.dut.u_pm_en_sync.gen_flops.OutputDelay_A 0081199098811547970672
tb.dut.u_prim_lc_sync_lc_dft_en.gen_flops.OutputDelay_A 0081199098811547970672
tb.dut.u_prim_lc_sync_lc_hw_debug_en.gen_flops.OutputDelay_A 0081199098811547970672
tb.dut.u_prim_mubi8_sync_otp_dis_rv_dm_late_debug.gen_flops.gen_no_stable_chks.OutputDelay_A 0081199098811547970672

Detail Report for Cover Sequences

Cover Sequences Uncovered:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C 00179145044000
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C 00179145044000
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C 00179145044000
tb.dut.tlul_assert_host_sba.gen_host_cov.b2bRsp_C 00179145044000
tb.dut.tlul_assert_host_sba.gen_host_cov.dValidNotAccepted_C 00179145044000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_dataChangedNotAccepted_C 00179145044000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_errorChangedNotAccepted_C 00179145044000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_opcodeChangedNotAccepted_C 00179145044000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_sinkChangedNotAccepted_C 00179145044000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_sizeChangedNotAccepted_C 00179145044000
tb.dut.tlul_assert_host_sba.gen_host_cov.d_sourceChangedNotAccepted_C 00179145044000

Cover Sequences All Matches:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_device_mem.gen_device_cov.aValidNotAccepted_C 0017914504416350163500
tb.dut.tlul_assert_device_mem.gen_device_cov.a_addressChangedNotAccepted_C 00179145044725172512
tb.dut.tlul_assert_device_mem.gen_device_cov.a_dataChangedNotAccepted_C 00179145044731573152
tb.dut.tlul_assert_device_mem.gen_device_cov.a_maskChangedNotAccepted_C 00179145044490549052
tb.dut.tlul_assert_device_mem.gen_device_cov.a_opcodeChangedNotAccepted_C 001791450444044042
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sizeChangedNotAccepted_C 00179145044377837782
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sourceChangedNotAccepted_C 00179145044395239522
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReqWithSameAddr_C 0017914504431902319020
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReq_C 001791450441528461528460
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bSameSource_C 00179145044159835159835101
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C 0017914504440400
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C 00179145044110
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C 00179145044110
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C 00179145044110
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C 001791450443033030
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C 001791450443563560
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C 0017914504422642264263

Cover Sequences First Matches:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_device_mem.gen_device_cov.aValidNotAccepted_C 0017914504416350163500
tb.dut.tlul_assert_device_mem.gen_device_cov.a_addressChangedNotAccepted_C 00179145044725172512
tb.dut.tlul_assert_device_mem.gen_device_cov.a_dataChangedNotAccepted_C 00179145044731573152
tb.dut.tlul_assert_device_mem.gen_device_cov.a_maskChangedNotAccepted_C 00179145044490549052
tb.dut.tlul_assert_device_mem.gen_device_cov.a_opcodeChangedNotAccepted_C 001791450444044042
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sizeChangedNotAccepted_C 00179145044377837782
tb.dut.tlul_assert_device_mem.gen_device_cov.a_sourceChangedNotAccepted_C 00179145044395239522
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReqWithSameAddr_C 0017914504431902319020
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bReq_C 001791450441528461528460
tb.dut.tlul_assert_device_mem.gen_device_cov.b2bSameSource_C 00179145044159835159835101
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C 0017914504440400
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C 00179145044110
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C 00179145044110
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C 00179145044110
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C 001791450443033030
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C 001791450443563560
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C 0017914504422642264263

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