Unified Coverage Report :: Design subhierarchy

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NAME	SCORE	LINE	COND	TOGGLE	BRANCH	ASSERT

top_earlgrey	85.37	90.65	78.79	90.49	91.83	75.11
clk_ctrl_and_main_pd_sva_if	100.00			100.00
u_adc_ctrl_aon	90.12			90.12
u_aes	96.62			96.62
u_alert_handler	97.21			97.21
u_aon_timer_aon	89.81			89.81
u_clkmgr_aon	94.93			94.93
u_csrng	97.36			97.36
u_dft_tap_breakout	100.00	100.00		100.00
u_edn0	95.85			95.85
u_edn1	93.38			93.38
u_entropy_src	90.21			90.21
u_flash_ctrl	95.60			95.60
u_gpio	94.44			94.44
u_hmac	84.81			84.81
u_i2c0	85.47			85.47
u_i2c1	85.55			85.55
u_i2c2	85.55			85.55
u_keymgr	89.29			89.29
u_kmac	99.29			99.29
u_lc_ctrl	92.91			92.91
u_otbn	98.19			98.19
u_otp_ctrl	84.74			84.74
u_pattgen	90.00			90.00
u_pinmux_aon	83.21	88.57	75.67	97.86	90.81	63.16
gen_alert_tx[0].u_prim_alert_sender	100.00			100.00
gen_wkup_detect[0].u_pinmux_wkup	69.87	77.78	68.18		63.64
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[1].u_pinmux_wkup	56.14	63.89	40.91		63.64
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[2].u_pinmux_wkup	45.45	50.00	31.82		54.55
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[3].u_pinmux_wkup	69.87	77.78	63.64		68.18
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[4].u_pinmux_wkup	45.45	50.00	31.82		54.55
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[5].u_pinmux_wkup	71.38	77.78	68.18		68.18
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[6].u_pinmux_wkup	45.45	50.00	31.82		54.55
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[7].u_pinmux_wkup	45.45	50.00	31.82		54.55
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pinmux_strap_sampling	98.82	99.62	95.65		100.00	100.00
subtree...
u_reg	77.42	88.00	75.26		94.55	51.87
subtree...
u_usbdev_aon_wake	98.43	100.00	95.59		98.11	100.00
filter_activity	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
filter_bus_reset	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
filter_sense	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pullup_en_cdc	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pwm_aon	88.89			88.89
u_pwrmgr_aon	93.04			93.04
u_rom_ctrl	94.69			94.69
u_rstmgr_aon	92.42			92.42
u_rv_core_ibex	88.93	94.12	75.28	90.30	92.80	92.14
subtree...
u_rv_dm	64.39			64.39
u_rv_plic	91.54	93.79	83.88	90.98	92.62	96.43
gen_alert_tx[0].u_prim_alert_sender	100.00			100.00
gen_target[0].u_target	91.54	88.57	77.60		100.00	100.00
u_prim_max_tree	91.52	88.49	77.58		100.00	100.00
u_gateway	75.00	100.00	25.00		100.00
u_prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_reg	93.03	94.26	87.88		89.97	100.00
subtree...
u_rv_timer	89.73			89.73
u_sensor_ctrl_aon	93.82	94.02	88.16	91.67	95.28	100.00
subtree...
u_spi_device	90.53			90.53
u_spi_host0	84.66			84.66
u_spi_host1	80.25			80.25
u_sram_ctrl_main	94.34			94.34
u_sram_ctrl_ret_aon	94.89			94.89
u_sysrst_ctrl_aon	91.02			91.02
u_uart0	90.07			90.07
u_uart1	90.13			90.13
u_uart2	89.47			89.47
u_uart3	89.54			89.54
u_usbdev	83.17			83.17
u_xbar_main	80.98			80.98
u_xbar_peri	89.73			89.73
u_ast	88.80			88.80
u_padring	99.20	99.77	100.00	96.22	100.00	100.00
gen_dio_pads[10].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[11].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[12].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[13].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[14].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[15].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[16].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[17].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[18].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[19].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[1].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[20].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[21].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[22].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[2].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[5].u_dio_pad	100.00	100.00				100.00
gen_generic.u_impl_generic	100.00	100.00				100.00
gen_dio_pads[8].u_dio_pad	100.00	100.00				100.00
gen_generic.u_impl_generic	100.00	100.00				100.00
gen_dio_pads[9].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[0].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[10].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[11].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[12].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[13].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[14].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[15].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[16].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[17].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[18].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[19].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[1].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[20].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[21].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[22].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[23].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[24].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[25].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[26].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[27].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[28].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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