Unified Coverage Report :: Design subhierarchy

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NAME	SCORE	LINE	COND	TOGGLE	BRANCH	ASSERT

top_earlgrey	91.56	93.43	82.18	90.57	94.60	97.02
clk_ctrl_and_main_pd_sva_if	100.00			100.00
u_adc_ctrl_aon	90.74			90.74
u_aes	96.90			96.90
u_alert_handler	97.38			97.38
u_aon_timer_aon	90.45			90.45
u_clkmgr_aon	95.10			95.10
u_csrng	97.03			97.03
u_dft_tap_breakout	100.00	100.00		100.00
u_edn0	95.19			95.19
u_edn1	92.56			92.56
u_entropy_src	88.09			88.09
u_flash_ctrl	86.89			86.89
u_gpio	94.07			94.07
u_hmac	83.54			83.54
u_i2c0	84.88			84.88
u_i2c1	84.97			84.97
u_i2c2	84.97			84.97
u_keymgr	89.25			89.25
u_kmac	99.29			99.29
u_lc_ctrl	93.01			93.01
u_otbn	98.19			98.19
u_otp_ctrl	84.83			84.83
u_pattgen	90.00			90.00
u_pinmux_aon	93.45	92.97	81.03	97.86	96.09	99.30
gen_alert_tx[0].u_prim_alert_sender	100.00			100.00
gen_wkup_detect[0].u_pinmux_wkup	77.78	83.33	77.27		72.73
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[1].u_pinmux_wkup	60.10	66.67	45.45		68.18
u_prim_filter	76.27	82.35	55.56		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[2].u_pinmux_wkup	60.10	66.67	45.45		68.18
u_prim_filter	76.27	82.35	55.56		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[3].u_pinmux_wkup	56.14	63.89	40.91		63.64
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[4].u_pinmux_wkup	76.26	83.33	72.73		72.73
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[5].u_pinmux_wkup	80.81	83.33	81.82		77.27
u_prim_filter	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[6].u_pinmux_wkup	60.10	66.67	45.45		68.18
u_prim_filter	76.27	82.35	55.56		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[7].u_pinmux_wkup	77.78	83.33	77.27		72.73
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pinmux_strap_sampling	98.49	99.62	95.65		98.70	100.00
subtree...
u_reg	93.31	92.68	80.77		99.81	100.00
subtree...
u_usbdev_aon_wake	98.43	100.00	95.59		98.11	100.00
filter_activity	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
filter_bus_reset	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
filter_sense	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pullup_en_cdc	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pwm_aon	90.20			90.20
u_pwrmgr_aon	93.48			93.48
u_rom_ctrl	97.33			97.33
u_rstmgr_aon	92.89			92.89
u_rv_core_ibex	91.48	96.51	81.21	90.78	96.77	92.14
subtree...
u_rv_dm	85.29			85.29
u_rv_plic	91.49	93.79	83.61	90.98	92.62	96.43
gen_alert_tx[0].u_prim_alert_sender	100.00			100.00
gen_target[0].u_target	91.37	88.57	76.90		100.00	100.00
u_prim_max_tree	91.34	88.49	76.87		100.00	100.00
u_gateway	75.00	100.00	25.00		100.00
u_prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_reg	93.03	94.26	87.88		89.97	100.00
subtree...
u_rv_timer	89.73			89.73
u_sensor_ctrl_aon	94.13	94.40	89.32	91.23	95.71	100.00
subtree...
u_spi_device	90.53			90.53
u_spi_host0	84.66			84.66
u_spi_host1	83.33			83.33
u_sram_ctrl_main	94.34			94.34
u_sram_ctrl_ret_aon	94.71			94.71
u_sysrst_ctrl_aon	91.02			91.02
u_uart0	90.07			90.07
u_uart1	89.47			89.47
u_uart2	89.47			89.47
u_uart3	89.54			89.54
u_usbdev	83.17			83.17
u_xbar_main	81.54			81.54
u_xbar_peri	89.77			89.77
u_ast	88.57			88.57
u_padring	99.20	99.77	100.00	96.22	100.00	100.00
gen_dio_pads[10].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[11].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[12].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[13].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[14].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[15].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[16].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[17].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[18].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[19].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[1].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[20].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[21].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[22].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[2].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[5].u_dio_pad	100.00	100.00				100.00
gen_generic.u_impl_generic	100.00	100.00				100.00
gen_dio_pads[8].u_dio_pad	100.00	100.00				100.00
gen_generic.u_impl_generic	100.00	100.00				100.00
gen_dio_pads[9].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[0].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[10].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[11].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[12].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[13].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[14].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[15].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[16].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[17].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[18].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[19].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[1].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[20].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[21].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[22].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[23].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[24].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[25].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[26].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[27].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[28].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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