Design subhierarchy
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NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
clk_ctrl_and_main_pd_sva_if 100.00 100.00
u_adc_ctrl_aon 90.74 90.74
u_aes 96.90 96.90
u_alert_handler 97.46 97.46
u_aon_timer_aon 90.45 90.45
u_clkmgr_aon 89.87 89.87
u_csrng 96.82 96.82
u_dft_tap_breakout 100.00 100.00 100.00
u_edn0 95.12 95.12
u_edn1 92.30 92.30
u_entropy_src 88.09 88.09
u_flash_ctrl 83.60 83.60
u_gpio 94.07 94.07
u_hmac 83.54 83.54
u_i2c0 84.88 84.88
u_i2c1 84.97 84.97
u_i2c2 84.97 84.97
u_keymgr 89.11 89.11
u_kmac 85.51 85.51
u_lc_ctrl 67.27 67.27
u_otbn 97.53 97.53
u_otp_ctrl 75.63 75.63
u_pattgen 88.67 88.67
u_pinmux_aon 89.81 87.80 74.59 97.99 89.37 99.30
gen_alert_tx[0].u_prim_alert_sender 100.00 100.00
gen_wkup_detect[0].u_pinmux_wkup 77.78 83.33 77.27 72.73
u_prim_filter 93.27 100.00 88.89 90.91
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
gen_wkup_detect[1].u_pinmux_wkup 78.37 80.56 81.82 72.73
u_prim_filter 100.00 100.00 100.00 100.00
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
gen_wkup_detect[2].u_pinmux_wkup 45.45 50.00 31.82 54.55
u_prim_filter 67.58 76.47 44.44 81.82
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
gen_wkup_detect[3].u_pinmux_wkup 56.14 63.89 40.91 63.64
u_prim_filter 67.58 76.47 44.44 81.82
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
gen_wkup_detect[4].u_pinmux_wkup 80.81 83.33 81.82 77.27
u_prim_filter 100.00 100.00 100.00 100.00
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
gen_wkup_detect[5].u_pinmux_wkup 80.81 83.33 81.82 77.27
u_prim_filter 100.00 100.00 100.00 100.00
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
gen_wkup_detect[6].u_pinmux_wkup 77.78 83.33 77.27 72.73
u_prim_filter 93.27 100.00 88.89 90.91
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
gen_wkup_detect[7].u_pinmux_wkup 68.35 77.78 63.64 63.64
u_prim_filter 93.27 100.00 88.89 90.91
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_pinmux_strap_sampling 98.82 99.62 95.65 100.00 100.00
subtree...
u_reg 87.87 86.82 73.10 91.55 100.00
subtree...
u_usbdev_aon_wake 98.43 100.00 95.59 98.11 100.00
filter_activity 100.00 100.00 100.00 100.00
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
filter_bus_reset 100.00 100.00 100.00 100.00
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
filter_sense 100.00 100.00 100.00 100.00
gen_async.prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_pullup_en_cdc 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_pwm_aon 90.20 90.20
u_pwrmgr_aon 93.07 93.07
u_rom_ctrl 97.29 97.29
u_rstmgr_aon 92.31 92.31
u_rv_core_ibex 91.49 96.43 81.43 90.70 96.77 92.14
subtree...
u_rv_dm 85.29 85.29
u_rv_plic 90.56 91.98 81.44 90.44 92.52 96.43
gen_alert_tx[0].u_prim_alert_sender 100.00 100.00
gen_target[0].u_target 91.45 88.57 77.24 100.00 100.00
u_prim_max_tree 91.42 88.49 77.21 100.00 100.00
u_gateway 75.00 100.00 25.00 100.00
u_prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_reg 91.49 91.96 84.15 89.83 100.00
subtree...
u_rv_timer 89.04 89.04
u_sensor_ctrl_aon 89.55 91.56 83.91 78.52 93.75 100.00
gen_alert_sync_assign[0].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[10].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[1].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[2].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[3].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[4].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[5].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[6].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[7].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[8].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
gen_alert_sync_assign[9].u_alert_in_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
u_alert_n_sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_alert_p_sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_init_chg 100.00 100.00 100.00 100.00
g_sync.u_sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_init_intr 100.00 100.00 100.00 100.00 100.00
u_io_intr 100.00 100.00 100.00 100.00 100.00
u_io_status_chg 100.00 100.00 100.00
g_sync.u_sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_prim_sec_anchor_buf 100.00 100.00
u_secure_anchor_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
u_reg 91.72 90.70 82.88 93.29 100.00
subtree...
u_wake_sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_spi_device 90.00 90.00
u_spi_host0 83.52 83.52
u_spi_host1 67.28 67.28
u_sram_ctrl_main 88.69 88.69
u_sram_ctrl_ret_aon 94.54 94.54
u_sysrst_ctrl_aon 91.02 91.02
u_uart0 90.07 90.07
u_uart1 90.13 90.13
u_uart2 90.13 90.13
u_uart3 90.20 90.20
u_usbdev 84.16 84.16
u_xbar_main 79.95 79.95
u_xbar_peri 88.33 88.33
0% 10% 20% 30% 40% 50% 60% 70% 80% 90% 100%