Unified Coverage Report :: Design subhierarchy

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NAME	SCORE	LINE	COND	TOGGLE	BRANCH	ASSERT

top_earlgrey	91.35	93.33	82.52	89.68	94.42	96.81
clk_ctrl_and_main_pd_sva_if	100.00			100.00
u_adc_ctrl_aon	90.12			90.12
u_aes	96.62			96.62
u_alert_handler	97.21			97.21
u_aon_timer_aon	89.81			89.81
u_clkmgr_aon	94.93			94.93
u_csrng	97.03			97.03
u_dft_tap_breakout	100.00	100.00		100.00
u_edn0	95.35			95.35
u_edn1	92.54			92.54
u_entropy_src	88.09			88.09
u_flash_ctrl	86.85			86.85
u_gpio	94.07			94.07
u_hmac	83.54			83.54
u_i2c0	90.12			90.12
u_i2c1	90.18			90.18
u_i2c2	90.18			90.18
u_keymgr	89.24			89.24
u_kmac	99.29			99.29
u_lc_ctrl	88.22			88.22
u_otbn	98.11			98.11
u_otp_ctrl	81.37			81.37
u_pattgen	90.00			90.00
u_pinmux_aon	93.54	93.00	81.69	97.81	95.90	99.30
gen_alert_tx[0].u_prim_alert_sender	100.00			100.00
gen_wkup_detect[0].u_pinmux_wkup	77.78	83.33	77.27		72.73
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[1].u_pinmux_wkup	77.78	83.33	77.27		72.73
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[2].u_pinmux_wkup	79.29	83.33	77.27		77.27
u_prim_filter	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[3].u_pinmux_wkup	79.29	83.33	77.27		77.27
u_prim_filter	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[4].u_pinmux_wkup	56.14	63.89	40.91		63.64
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[5].u_pinmux_wkup	56.14	63.89	40.91		63.64
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[6].u_pinmux_wkup	56.14	63.89	40.91		63.64
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[7].u_pinmux_wkup	56.14	63.89	40.91		63.64
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pinmux_strap_sampling	98.82	99.62	95.65		100.00	100.00
subtree...
u_reg	93.43	92.73	81.47		99.49	100.00
subtree...
u_usbdev_aon_wake	98.32	100.00	95.16		98.11	100.00
filter_activity	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
filter_bus_reset	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
filter_sense	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pullup_en_cdc	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pwm_aon	90.20			90.20
u_pwrmgr_aon	93.48			93.48
u_rom_ctrl	97.33			97.33
u_rstmgr_aon	92.89			92.89
u_rv_core_ibex	91.40	96.52	81.90	90.86	96.27	91.43
subtree...
u_rv_dm	81.46			81.46
u_rv_plic	91.48	93.79	83.56	90.98	92.62	96.43
gen_alert_tx[0].u_prim_alert_sender	100.00			100.00
gen_target[0].u_target	91.34	88.57	76.78		100.00	100.00
u_prim_max_tree	91.31	88.49	76.75		100.00	100.00
u_gateway	75.00	100.00	25.00		100.00
u_prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_reg	93.03	94.26	87.88		89.97	100.00
subtree...
u_rv_timer	89.73			89.73
u_sensor_ctrl_aon	93.48	91.54	88.81	93.39	93.65	100.00
subtree...
u_spi_device	90.53			90.53
u_spi_host0	84.66			84.66
u_spi_host1	82.72			82.72
u_sram_ctrl_main	93.98			93.98
u_sram_ctrl_ret_aon	94.89			94.89
u_sysrst_ctrl_aon	91.02			91.02
u_uart0	90.07			90.07
u_uart1	90.13			90.13
u_uart2	90.13			90.13
u_uart3	90.20			90.20
u_usbdev	82.84			82.84
u_xbar_main	80.89			80.89
u_xbar_peri	89.79			89.79
u_ast	89.72			89.72
u_padring	99.20	99.77	100.00	96.22	100.00	100.00
gen_dio_pads[10].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[11].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[12].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[13].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[14].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[15].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[16].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[17].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[18].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[19].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[1].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[20].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[21].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[22].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[2].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[5].u_dio_pad	100.00	100.00				100.00
gen_generic.u_impl_generic	100.00	100.00				100.00
gen_dio_pads[8].u_dio_pad	100.00	100.00				100.00
gen_generic.u_impl_generic	100.00	100.00				100.00
gen_dio_pads[9].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[0].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[10].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[11].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[12].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[13].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[14].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[15].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[16].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[17].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[18].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[19].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[1].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[20].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[21].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[22].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[23].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[24].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[25].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[26].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[27].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[28].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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